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W9812G6JH
6. BLOCK DIAGRAM
CLK
CLOCK
BUFFER
CKE
CS
CONTROL
SIGNAL
RAS
CAS
COMMAND
DECODER
GENERATOR
COLUMN DECODER
COLUMN DECODER
WE
R
O
W
R
O
W
A10
D
E
C
O
CELL ARRAY
BANK #0
D
E
C
O
CELL ARRAY
BANK #1
D
E
D
E
MODE
R
R
A0
REGISTER
SENSE AMPLIFIER
SENSE AMPLIFIER
ADDRESS
BUFFER
A9
A11
DMn
BS0
BS1
DQ0
DATA CONTROL
DQ
CIRCUIT
BUFFER
DQ15
REFRESH
COUNTER
COLUMN
COUNTER
R
O
W
COLUMN DECODER
R
O
W
COLUMN DECODER
UDQM
LDQM
D
E
C
O
D
E
R
CELL ARRAY
BANK #2
SENSE AMPLIFIER
D
E
C
O
D
E
R
CELL ARRAY
BANK #3
SENSE AMPLIFIER
Note: The cell array configuration is 4096 * 512 * 16.
Publication Release Date: Jun. 25, 2013
-6-
Revision A06
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